浙江大学城市学院。
2009 — 2010 学年第二学期期末考试试卷。
计算机组成》
开课单位： 计算分院 ；考试形式：闭卷；考试时间：2024年7月_6日；
所需时间： 120分钟。
一．选择题 (本大题共 25题，每题1分，共25分。)
二．填空题 (本大题共10题，每空格1分，共10分。)
三．分析题(本大题共__5__题，每题__7__分，共__35___分。)
流水过程中通常会出现以下三种相关冲突，使流水线断流。
1. 资源相关
2. 数据相关
3. 控制相关。
读后写。写后写。写后读。
（1） 4分。
2） 是哈佛结构， 1分。
可以放在同一个缓存中，但是将指令和数据分别存放，可以使取指令和取数据操作不容易产生冲突，从而提高整体速度。 2分。
组相联 1) cache 4k 64组每组 4行每行16字。
主存64k 共64群按64块一群每块16字
先根据 6位组号s 确定主存映射到cache的组，然后将该组4行cache的tag标志（s-d）部分(长度为6位)与内存地址的前6位进行比较。如果命中，再根据行内字地址进行比对。 4分。
aae6=1010 1010 1110 0110
根据 s=101111 可确定映射到主存编号为46的组（所有组序号为0-63）即 g47，该组一共有4行，行号为l188—l191, 然后根据s-d=101010 与该组的4行进行比较，以确定是否命中。如果命中，则根据w=内地址进行寻址。
3分其中算出 46，给2分。
1) a: cpu总线4分)
b：系统总线。
c：高速总线。
d：扩充总线。
23分)体现了高速、中速、低速设备连接到不同总线上同时进行工作，以提高总线的效率和吞吐量。
处理器结构的变化不影响高速总线。
cpu和cache之间采用高速的cpu总线 。
主存连在系统总线上。
高速总线上可以连接高速lan（100mb/s局域网）、**接口、图形接口、scsi接口（支持本地磁盘驱动器和其他外设）、firewire接口（支持大容量i/o设备）。
高速总线通过扩充总线接口与扩充总线相连，扩充总线上可以连接串行方式工作的i/o设备。
桥是一种具有缓冲、转换、控制功能的逻辑电路。
cpu总线、系统总线和高速总线通过桥彼此相连。
5. (1) 总长32位 4分。
2）控存原理 3分。
四．综合题(本大题共__3__题，每题__10_分，共__30___分。)四综合题：
方框图3分*2
控制命令 1分*2
微指令 1分*2
1) 6分。
op目标源add s, d
op 基址源变址
位移量sta s, m
op目标。20 位地址lda d, m
1) 完成第一条指令时间最短，第二条指令时间最长，因为第二条指令还需要进行地址变换（变址寻址2分。
3) add=ah=001010 2分。
sta=1bh=01 1011
lda=3ch=11 1100
1d34 h= 0001 1101 0011 0100 操作码部分为0001 11, 因为是单字长，所以应该是add指令，编码而错，需要改成001010 指令则为 0010 10 00 0011 0100 = 2834h，含义是将3号源寄存器内容传到4号目标寄存器。
f0f8)h (5ad2)h= 1111 0000 1111 1000 0101 1010 1101 0010 操作码部分为1111 00 与lda指令一致，编码正确，代表lda指令，含义是将主存85ad2 h单元的内容传送到15号目标寄存器。
1） 设置设备h的ei标志为03
3） ir23
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